VHDL的記憶體寫法 |
答題得分者是:mis881085
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sungkuo
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我在QuartusII的help學習記憶體寫法
拿裡面的範例練習
範例簡單架構大概如下:
LIBRARY ieee; USE ieee.std_logic_1164.all; ENTITY tstrom IS PORT (...); END tstrom; ARCHITECTURE behavior OF tstrom IS COMPONENT asyn_rom_256x15 GENERIC (...); PORT (...); END COMPONENT; BEGIN u1: asyn_rom_256x15 GENERIC MAP (...) PORT MAP (...); END behavior;compiler後,出現error說我沒有asyn_rom_256x15這個entity 請問:我要怎麼編輯 asyn_rom_256x15這個entity呢?? 發表人 - sungkuo 於 2005/07/30 01:37:40 |
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sungkuo
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mis881085
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我專題的程式碼內 也有想過使用MEMORY
不過我只會寫成PACKAGE 我想把它改成FUNCTION 好像不行
但因該 能夠讓您參考看看 如果使用QII COMPILER因該不會有問題
如果用ModelSim 的話 可能要抓ㄧ下lpm_components這個LIBRARY
PS: 有人知道怎麼把這段東西寫成FUNCTION
或者 怎麼在FOR LOOP 裡面 使用它嗎?
PS 已修正格式 不知是否正確
PACKAGE rom_constants IS constant DATA_WIDTH : INTEGER := 8; constant ADDR_WIDTH : INTEGER := 8; END rom_constants; Library IEEE; Use IEEE.std_logic_1164.all; Use IEEE.std_logic_arith.all; Use IEEE.std_logic_unsigned.all; LIBRARY lpm; USE lpm.lpm_components.all; LIBRARY work; USE work.rom_constants.ALL; ENTITY CPU IS PORT( CLK:IN STD_LOGIC; OE:IN STD_LOGIC; PC:IN STD_LOGIC_vector(7 downto 0); ins:out STD_LOGIC_vector(7 downto 0) ); end cpu; architecture a of cpu is begin prom:LPM_ROM GENERIC MAP (LPM_WIDTH=>8, LPM_WIDTHAD=>8, LPM_FILE=> "prog1.mif") PORT MAP(address=>pc, memenab=>OE, inclock => clk, outclock => clk, q=>ins); END a; Memory之內容設定prog1.mif: % Memory Initialization File (prog1.mif)% DEPTH=256; --設定表格內容為256bit WIDTH = 8; --設定表格內每個元件皆為8bit寬度 ADDRESS_RADIX = HEX; --設定資料線編排為16進制 DATA_RADIX = HEX; --設定內容格式為16進制 CONTENT BEGIN—以下為表格內資料 0 : 63; 1 : 7c; 2 : 77; 3 : 7b; 4 : f2; --....略 END;發表人 - mis881085 於 2005/07/31 01:23:45 發表人 - mis881085 於 2005/07/31 01:25:43 |
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sungkuo
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